Geradores e Verificadores de Paridade

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Dispositivos da família lógica de geradores e verificadores de paridade são dispositivos de nível de componente usados para avaliar a quantidade de bits em uma palavra digital com valor 1, e gerar (ou avaliar) um bit de paridade adicional que indica se essa quantidade é par ou ímpar. Essa função é comumente utilizada como um meio simples de detectar erros de dados que podem ter sido introduzidos durante a transmissão.